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ASIC中时钟MUX电路结构时序约束的方法分析

许立明; 李沛杰; 杨堃; 张丽 集成电路应用 2019年第11期

摘要:时钟切换在数字集成电路设计中十分常见,对时钟MUX电路结构的正确时序约束显得非常重要。介绍几种常见的时钟MUX电路结构,使用业界标准Synopsys设计约束(SDC)对不同MUX电路结构分别给出几种时序约束方法。详细分析了各MUX结构约束的原理。给出约束方法在40 nm、16 nm、7 nm等工艺下均成功流片。

关键词:集成电路设计asic时序约束时钟创建时钟

单位:天津市滨海新区信息技术创新中心; 天津300072; 国家数字交换系统工程技术研究中心; 河南450007

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集成电路应用

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